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#1 Re: Xilinx/Altera/FPGA/CPLD/Verilog » 蚂蚁矿板分享 » 2024-09-03 09:07:25

Nightwatch

我的板子上1.3原理图是1.0，差别不大

#2 Re: Xilinx/Altera/FPGA/CPLD/Verilog » 蚂蚁矿板分享 » 2024-08-30 21:43:24

Nightwatch

缺失的jtag端子为 PHB 2.0 2x7 ；IO端子为 PHB 2.0 2x9

#3 Xilinx/Altera/FPGA/CPLD/Verilog » 蚂蚁矿板分享 » 2024-08-30 21:41:47

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回复： 5

AntMiner_ControlBoard_XC7Z010_V1.3
AntMiner_ControlBoard_XC7010_V1.01控制板.pdf

#4 Re: 硬件设计 KiCAD/Protel/DXP/PADS/ORCAD/EAGLE » pcb都快被过孔打成了筛子 » 2020-07-03 21:56:32

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板子看起来很好看，是做什么的，如果手工焊接的话是否可以在芯片接地焊盘开个大的通孔，方便手工焊贴

#5 Re: 全志 SOC » 分享新画的H3四层底板工程 » 2020-07-03 21:53:25

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四层板可以引出全部功能吗

#6 Re: 全志 SOC » 全志F1C200S原理图+PCB(公版) » 2020-07-03 21:50:15

Nightwatch

谢谢楼主，学习一下

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