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nekomona · RISC-V

@mengxp
ASIC的数字后端（布局布线之类一大堆）工具也是自动工具，人工布线会吐血的，只不过相比于FPGA开发可以优化的空间和带来的收益相对较大，同时单次流片失败的损失较大，所以需要比较多的工时做自动工具参数配置的调整与系统验证。商用IP核相当一部分也会作为软核（加密RTL代码/综合后网表）与对应的部分自动工具参数一同提供，和硬核宏块相比可以和系统的其他部分更有效的整合（硬核宏块会产生单独的供电线路和无法重复利用的空隙）。在均为软核的情况下商用IP主要的优势大概会在经过较为充分的验证与提供一定的技术支持，也会出现一些商用IP公司将基本款开源并出售同系列不同子型号IP的场景。

nekomona · Xilinx/Altera/FPGA/CPLD/Verilog

ESP-XVCD那个优化到后面发现整个传输的大部分过程已经是在等wifi协议栈吐数了，IO部分原设计的8266一下凑不出能做并串的外设，只靠bitbang的速度在扣掉库函数之后也比较难想到再做提升的方法。速度方面理论上现在最容易买到的山寨jtag-hs2（FT232H/FT2232H）应该是可以跑满标称30M的MPSSE速度的，也许可以看一下是不是有黑心厂家换了个FT2232D进去，那个功能和VID/UID可以和2232H一样，但是速度掉了一大截-w-、

WhyCan Forum(哇酷开发者社区)

#1 Re: RISC-V » 与 ARM 相比，Risc-V 有多好？ » 2022-05-15 23:20:47

#2 Re: Xilinx/Altera/FPGA/CPLD/Verilog » 最近研究了下Xilinx 的XVC，发现jlink有了个新玩法，可以白嫖一个xilinx高速下载器了 » 2022-05-15 08:43:45

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