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我最近在设计全志a33开发板，6层板，能不能就是a0-15信号线分别在l1和l4走线，做了等长和阻抗匹配，单层内有点走不开，l5和l6留给电源层，请问这样做可以吗，大佬们
离线
能做但不优先。地址线尽量同层同参考面，换层处补地过孔，避开电源分割再做仿真。