最近工作需要调一大堆PWM发波电路,每一块实验板都要画FPGA,JTAG桥和PMIC,遂心生一计,何不把我每次都重复的部分单独拉出来,搞个核心板封起来当IC用?
基于这个想法,我开发了一块尺寸仅9.5mm*10.5mm的核心板,集成上述功能,外部连上供电就能跑,连上USB还能下载程序或模拟SPI主机和FPGA通信。
因为公司的知识产权协议允许我拥有工作中开发的工具的知识产权,遂将这个项目开源出来,和大家分享。
传送门: https://github.com/blueskull/PicoGate
固件见我之前的USB-JTAG项目,支持SRAM下载,很短的未来里会新增功能,尤其是FLASH下载。敬请期待。
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“公司的知识产权协议允许我拥有工作中开发的工具的知识产权”
什么高大上的公司竟然允许这样
甲方工作中为乙方产生的可交付直接结果,例如按照客户要求或内部立项要求所研发的电路拓扑、电路原理图、电路板版图、集成电路版图等,和上述结果的中间过程结果,例如上述结果在迭代过程中产生的中间版本,其知识产权归乙方所有。甲方在产生上述结果的过程中所开发之工具,例如EDA软件、仿真软件、测试方案及软硬件等,其知识产权归甲方所有,并授予乙方无条件的、永久的、免费的使用权。
这是我的合同里面的原文。大老板完全OK,秒同意,但是下面的法务有点顾虑。这个版本是和HR和法务拉锯战谈判下来的产物。
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高云的价格如何
代理报的原厂管控价25,有渠道从大型OEM窜货会便宜很多。具体价格看渠道,看量,看你怎么谈。
FPGA这东西价格就是玄学,我还见过XC6SLX9卖35块钱,全新非拆。反过来现在EPM570居然卖好几百,因为高附加值的老旧工业设计里面用的多。
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@Blueskull
ep4ce10都涨到400了,想找家国产的替代,不知道哪家靠谱
小容量的都靠谱,都是抄的国外成熟的核心技术(高云和AGM高管部分是Lattice出来的)配上自己的外围。
大容量的复旦微有,几百kLUT的都有,一比一抄的Virtex,但是有些黑盒IP要改,全白盒IP可以pin-to-pin直接换。
纯国产技术的(紫光?)没用过,不了解。
10kLUT可以看看高云的18kLUT产品GW2A-LV18,实际上有21.5kLUT。但是高云的逻辑门慢一些,可能时序不满足。
同一代产品,Xilinx最快,Intel次之,再下面高云和AGM,Lattice略慢一点垫底。
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可能需要翻墙,或者你家网络太差。不同地区,不同运营商墙的东西不完全一样。
EEPROM的问题,我的板子没有FT2232H,所以没有EEPROM。我是用CH552做的下载桥,下一代准备换ESP8285或者ESP8685。
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体积确实小,不过好多过孔打到QFN的焊盘上了。
是的,所以这板子只能找立创生产。别人家做不了免费铝片塞孔(阻焊塞孔)。
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Rev 4已更新,本版本增加了1个可变电压IO口和一个5V IO口,去掉了1个3.3V IO口,并去掉了动态更改5V IO方向的能力。
本版本5V IO方向可在烧录PMIC固件是更改,也可通过I2C在MCU里更改,该部分代码尚未实现。
本版本将LGA焊盘改为BGA焊盘以改善焊接良率及可靠性,同时微调RC器件参数以增强系统稳定性并减少贴片成本。
本版本增加了USB双缓冲和TCK恒定时钟输出功能,用以实现高速下载以及FPGA Flash编程(固件已实现,上位机尚未实现)。
本版本增加了VBUS分压器开关,因此VBUS分压电阻在不读取VBUS电压时不消耗功率,从而减少待机功耗。
本版本将上位机软件从Python移植至NodeJS(错误的决定,未来还会移植回Python),并重构了USB底层API。
https://github.com/blueskull/PicoGate
https://github.com/blueskull/CH552-JTAG
本坑已填,硬件除非有明显bug,否则不会更新。软件会继续添加功能。
同时,硬件开新坑,基于ESP8685的无线GW1NZ核心板,板载ESP的所有可用ADC+GW1NZ的所有可用IO+PMIC的若干路5V IO。敬请期待。
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支持楼主,期待GW1NZ开源:D,不过高云的芯片哪里能买到呢?
小批量私信我,大批量找原厂
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这个板子真小,用什么工具开发
KiCAD
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楼主这个USB-JTAG只能在AGM和Altera上用吗?能在赛灵思上用不
只能在高云FPGA上用,改上位机可以兼容Xilinx(我没有实现),不支持Altera/AGM。
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请问这个FPGA芯片批量拿货价格几何?
十块钱以下,具体多少看你怎么谈咯。
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